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通信雷達一體科研平臺解決方案

時間:2021-07-27
摘要:通信雷達一體化科研平臺,利用異構計算打通SDR算法鏈路,加速開發進程。在此框架下,FPGA可實現DDC/DUC、NCO、IQ不平衡校準、小數降采樣、信道均衡、iFFT/FFT;CPU可實現基于AVX指令集加速的iFFT/FFT等浮點運算以及鏈路控制;GPU實現信道估計、MIMO預編碼相關的矩陣計
通信雷達一體化科研平臺,利用異構計算打通SDR算法鏈路,加速開發進程。在此框架下,FPGA可實現DDC/DUC、NCO、IQ不平衡校準、小數降采樣、信道均衡、iFFT/FFT;CPU可實現基于AVX指令集加速的iFFT/FFT等浮點運算以及鏈路控制;GPU實現信道估計、MIMO預編碼相關的矩陣計算。相對于傳統高度依賴FPGA的開發模式,此平臺用戶可以更快的實現通信、雷達算法的驗證。同時此平臺也支持接入智能超表面,實現對波束的可控反射。



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